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本項(xiàng)目是第五代PCIe存儲(chǔ)控制芯片研發(fā)及產(chǎn)業(yè)化，主要應(yīng)用于高速存儲(chǔ), 為5G手機(jī)、工業(yè)電腦、5G基站、服務(wù)器、存儲(chǔ)陣列、云和企業(yè)系統(tǒng)提供更快速與高可靠度的存儲(chǔ)方案。芯片采用了全球首創(chuàng)的自研分布式架構(gòu)和硬件及固件融合IP核，解決了現(xiàn)有數(shù)據(jù)存儲(chǔ)方案無(wú)法滿足海量數(shù)據(jù)的多樣化存儲(chǔ)、高速讀寫及存儲(chǔ)的實(shí)效性、安全性等痛點(diǎn)，比目前國(guó)內(nèi)主流SSD主控方案超前1-2代，有望填補(bǔ)國(guó)內(nèi)高端存儲(chǔ)芯片的空白，突破行業(yè)壟斷。公司的芯片是SSD存儲(chǔ)的核心技術(shù)，主要定位在國(guó)產(chǎn)替代市場(chǎng)，可以廣泛應(yīng)用于PC、SSD模塊、工業(yè)互聯(lián)網(wǎng)、人工智能、AR/VR、高速云計(jì)算等行業(yè)場(chǎng)景。通過(guò)我們?nèi)蚴讋?chuàng)的自研單顆PCIe 5.0 CPU +分布式Micro IP設(shè)計(jì)架構(gòu)，可以把外圍的功能分散到不同的自研IP核里去，且支持動(dòng)態(tài)調(diào)整CPU頻率，在不依靠增加CPU數(shù)量的情況下，滿足PCIe 增速要求，CPU 數(shù)量少、低熱、面積小、價(jià)格低的同時(shí)各個(gè)自研 Micro IP 運(yùn)行速度更快，效率更高。相比傳統(tǒng)PCIe 3/4/5設(shè)計(jì)架構(gòu)CPU執(zhí)行指令的方式“依序執(zhí)行”，需要32個(gè)時(shí)鐘周期，我們的“硬件執(zhí)行”方式可以讓Micro IP同時(shí)執(zhí)行，只需要1個(gè)時(shí)鐘周期，極大程度上縮短CPU響應(yīng)和處理時(shí)間，以及運(yùn)算量，能夠大幅降低芯片溫度，增加NAND顆粒的壽命。 【展開】 【收起】